Dispositivi logici programmabili complessi 64MC 6.7NS 100VQFP di XC2C64A-7VQG100C CPLD IC
100VQFP CPLD IC
,64MC CPLD IC
,XC2C64A-7VQG100C
Caratteristiche
• Ottimizzato per i sistemi 1.8V
- Velocemente quanto 4,6 ritardi di logica del perno--perno di NS
- Basso quanto una corrente tranquilla di 15 μA
• I migliore 0,18 micron CMOS CPLD dell'industria
- Architettura ottimizzata per l'efficace sintesi di logica
- operazione dell'ingresso/uscita di Multi-tensione — 1.5V a 3.3V
• Disponibile nelle opzioni multiple del pacchetto
- 44-pin VQFP con 33 l'utente I/Os
- 48-land QFN con 37 l'utente I/Os
- 56-ball CP BGA con 45 l'utente I/Os
- 100-pin VQFP con 64 l'utente I/Os
- disponibile senza Pb per tutti i pacchetti
• Caratteristiche del sistema avanzate
- Il più velocemente nella programmazione di sistema · ISP 1.8V facendo uso di IEEE 1532 (JTAG) interfacce - prova di ricerca di frontiera di IEEE1149.1 JTAG
- Input facoltativo di Schmitt-innesco (per perno)
- Due banche separate dell'ingresso/uscita - generazione 100% di termine del prodotto di RealDigital CMOS
- Modi di sincronizzazione flessibili · DualEDGE facoltativo ha avviato i registri
- Opzioni globali del segnale con controllo del macrocell
· Orologi globali multipli con la selezione di fase per macrocell
· L'uscita globale multipla permette a · Insieme/risistemazione globali
- Gli orologi efficienti di termine di controllo, uscita permette a ed insieme/risistemazioni per ogni macrocell e compartecipi attraverso i blocchi funzionali
- Sicurezza avanzata di progettazione
- Bus-tenuta facoltativa, stato 3, o pullup debole sui perni selezionati dell'ingresso/uscita
- opzione di uscita dello Aperto scolo per azionamento del LED e Fissare-O
- Motivi configurabili facoltativi su I/Os inutilizzato
- Tensioni miste dell'ingresso/uscita compatibili con i livelli logici 1.5V, 1.8V, 2.5V e 3.3V
- Architettura di PLA · Conservazione superiore di piedinatura
· routability 100% di termine del prodotto attraverso il blocco funzionale
- Pluggable caldi si riferiscono alla scheda di dati della famiglia di CoolRunner™-II per la descrizione dell'architettura.
Tecnologia di progettazione di RealDigital
Xilinx® CoolRunner-II CPLDs è fabbricato su una tecnologia della trasformazione di 0,18 micron che è derivata da sviluppo del prodotto di FPGA del bordo di attacco. CoolRunner-II CPLDs impiega RealDigital, una tecnica di progettazione che usa la tecnologia CMOS sia nel montaggio che nella metodologia di progettazione. La tecnologia di progettazione di RealDigital impiega una cascata dei portoni di CMOS per implementare la somma dei prodotti invece di metodologia tradizionale dell'amplificatore di senso. dovuto questa tecnologia, Xilinx CoolRunner-II CPLDs raggiungere sia rendimento elevato che operazione di potere basso.
Attributi di prodotto
Stato del prodotto
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Attivo
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Tipo programmabile
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Nel sistema programmabile
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Tpd di tempo di ritardo (1) massimo
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6,7 NS
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Rifornimento di tensione - interno
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1.7V ~ 1.9V
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Numero degli elementi di logica/blocchi
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4
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Numero di Macrocells
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64
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Numero dei portoni
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1500
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Numero di ingresso/uscita
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64
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Temperatura di funzionamento
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0°C ~ 70°C (TUM)
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Montaggio del tipo
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Supporto di superficie
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Pacchetto/caso
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100-TQFP
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Pacchetto del dispositivo del fornitore
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100-VQFP (14x14)
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Numero del prodotto di base
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XC2C64
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ATTRIBUTO | DESCRIZIONE |
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Stato di RoHS | ROHS3 compiacente |
Livello di sensibilità di umidità (MSL) | 3 (168 ore) |
Stato di PORTATA | RAGGIUNGA inalterato |
ECCN | EAR99 |
HTSUS | 8542.39.0001 |
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1. Siamo professionali nei componenti elettronici, particolarmente in circuito integrato (IC), noi possiamo fornire quasi tutti i tipi di IC nell'originale e di alta qualità.
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FAQ
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